27-三相交错Buck采样机制设计

发布时间:2026/11/4 16:31:31
27-三相交错Buck采样机制设计 三相交错总电流单次采样位置、计算与触发1总电流的理想采样位置选择总电流波形中一段较宽、稳定的采样窗口在窗口中点采样。这个位置离两侧开关沿较远能避开尖峰和振铃采样更可靠。不必固定选上升段或下降段也不必对齐A相电流的中点。2不同占空比采样位置的计算计算一个PWM周期内A、B、C三相的6个开关时刻并按时间顺序排列。相邻开关时刻之间形成候选采样窗口避开开关时刻后选择有效宽窗口的中点采样。1.算开关沿。设周期计数为N、中心为M、占空比为D则脉冲半宽HND/2A相两个开关沿为M-H和MH。B、C相的开关沿分别在此基础上减去相位偏移P_B、P_C结果超出一个周期时折回到0N-1。2.找有效窗口。将三相共6个开关沿按时间排序避开每个开关沿附近的尖峰、振铃和电路恢复时间。比较剩余窗口的宽度选择一个足够宽、实测波形也稳定的窗口。3.取窗口中点。若选中窗口的有效起点和终点分别为L、R则目标采样位置为S(LR)/2。以当前30%占空比为例6个开关沿约为42、792、875、1625、1709、2459未扣除避让时间时三个宽窗口的中点约为417、1250、2084。可先选417作为候选点再用实测波形确认。417不是所有占空比通用的固定值。3用A相计数器触发总电流采样前面得到的S已经是A相计数器上的位置。只要让A相计数器数到指定值时发出ADC触发即可。具体配置逻辑是1单独设置一个采样比较值。保留CMP0/1产生A相驱动波形另用CMP16作为ADC触发比较器。将采样触发值写入CMP16对应的影子寄存器并指定CMP16使用A相的counter0。2接通硬件触发链路。counter0数到CMP16的比较值时产生一次比较事件将该事件送到PWM0_TRGO_0再经TRGM0送到ADC的TRG0A触发总电流通道采样。counter0每周期经过该比较值一次因此每周期触发一次。3补偿ADC延迟。比较事件发生后ADC才开始执行采样。若从比较事件到实际采样时刻相差nτ个计数CMP16中应设置CADCS-nτ2500mod2500这样提前触发实际采样才会落在S。例如S417、延迟为20个计数就将CMP16设为397。若尚未确定延迟应通过ADC时序和实测确认不能直接把20当作固定值。整条链路可以概括为A相counter0数到CADC→ CMP16事件→ PWM0_TRGO_0 → TRGM0 → ADC TRG0A →总电流采样。

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